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[主观]

设计一个可以控制计数功能的计数器,当X=0时,计数器以二进制数序列000、 001、010、011、 100、101、110、111计数并重复。当X=1时,计数器以格雷码序列000、001、 011、 010、 110、111、101、100计数并重复,要求:(1)画出计数器的状态图和ASM图;(2)用Verilog HDL语言描述系统的工作过程。

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第1题

一个数字系统的数据处理单元由触发器E和F、4位二进制计数器A以及必要的门电路组成。计数器的各位为A4、A3、A2、A1系统开始处于初始状态,当信号S=0,系统保持在初始状态;当S=1时,计数器A和触发器F清零。从下一个时钟脉冲开始,计数器进行加1计数,直到系统操作停止。A4和A3的值决定了系统的操作顺序。
当A3=0时,触发器E清零,计数器继续计数。
当A3=1时,触发器E置1,并检测A4,A4=0时,继续计数;A4=1时,触发器F置1,并停止计数,回到系统初始状态。
(1)试画出该系统的ASM图
(2)画出该系统控制单元的状态图,并用D触发器及必要的门电路设计控制单元

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第2题

如图图题6-45所示,车辆速度检测装置有两个分离距离为10m的车辆传感器,当车辆经过第1个传感器
如图图题6-45所示,车辆速度检测装置有两个分离距离为10m的车辆传感器,当车辆经过第1个传感器时,该传感器输出高电平脉冲,这时计数器开始计数:当车辆经过第2个传感器时,该传感器输出高电平脉冲,计数器停止计数:若是计数时钟周期T为0.1s,则计数器计数个数N乘以时钟周期就是时间,由于两传感器之间距离已知,则车速V=10m/(N*T)。试设计该装置,要求用数码管显示计数器计数值。(可参考图题6-45)


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第3题

图题6-27所示为具有同步预置功能的同步四位二进制加法计数器74LS161组成的计数电路,试说明该
图题6-27所示为具有同步预置功能的同步四位二进制加法计数器74LS161组成的计数电路,试说明该计数电路是多少进制。


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第4题

图题6-28所示为具有同步预置功能的同步四位二进制加法计数器74LS161组成的计数电路,试说明该
图题6-28所示为具有同步预置功能的同步四位二进制加法计数器74LS161组成的计数电路,试说明该计数电路是多少进制。


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第5题

图题6-26所示为具有异步清除功能的同步四位二进制加法计数器74LS161组成的计数电路,试说明该
图题6-26所示为具有异步清除功能的同步四位二进制加法计数器74LS161组成的计数电路,试说明该计数电路是多少进制。


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第6题

图题6-25所示为具有同步清除功能的同步四位二进制加法计数器74LS163组成的计数器电路,试说明
图题6-25所示为具有同步清除功能的同步四位二进制加法计数器74LS163组成的计数器电路,试说明该计数电路是多少进制。


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第7题

一个地下车库可以停放99辆车,在入口处和出口处分别安装有车辆传感器用于检测车辆的进入和驶出,试设计一个车库车数量显示装置,该装置可以显示车库内停放车的数量。(当检测到车辆时,传感器输出幅值为+5V的脉冲信号)。(建议采用同步十进制双时钟加减计数器74LS192或是可预置数同步4位加减十进制计数器74LS190)

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第8题

同步计数器的计数速度比异步计数器的速度快。()

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第9题

图题 6-24所示为异步4位二进制加法计数器74LS293组成的计数器电路,试说明该计数电路是多少进
图题 6-24所示为异步4位二进制加法计数器74LS293组成的计数器电路,
试说明该计数电路是多少进制计数器,并说明复位信号RESET的有效电平,


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第10题

对于监测控制值,下列描述错误的是()。
A、设计单位应在设计图纸中明确控制值
B、监测数据超过控制值时发起报警
C、监测控制值分为累计变化值和变化速率值,对于力学监测项目还包括最大值和最小值
D、当产权单位要求的控制值与设计冲突时,以设计图纸为准。

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第11题

早期的硬件乘法器设计中,通常采用加和移位相结合的方法,具体算法是(),但需要有()控制。

A、并行加法和串行右移;计数器

B、串行加法和串行右移;触发器

C、串行加法和串行移位;触发器

D、并行加法和串行左移;计数器

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